Porta Parallela - Software ["Dentro il Computer" di Giobe®2000]

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Porta Parallela

Applicazioni Software

PROGETTO nÂ° 13 - 7/7 [138 di 189]

Analisi del Problema · Analisi del Codice · Procedure importanti · Schema interfaccia

Porta Parallela - OUTPUT di Dati a 64 bit - Interfaccia con 8 memorie D-Type '374

Analisi delle procedure importanti [2 di 2]

Certamente la parte più importante della procedura Out64bit è quella finale, riportata nella casella di testo insieme alla sottoprocedura Clock:

Progetto

NB: se il testo nell'Area ti sembra strano
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;¿Ricarica il puntatore alla zona  contenente il
        LEA     DI,Dato_64    ;³il dato binario a 64 da  spedire  in  sequenza
                              ;Ùsul Registro DATI  0378H della porta parallela
        MOV     DX,PRNdato    ; Punta il  Registro DATI 0378H  della parallela
        MOV     CX,8          ; Carica il contatore per il servizio di 8 bytes
Out_1:  MOV     AL,ES:[DI]    ;¿Eroga in stretta sequenza gli 8 bytes generan-
        OUT     DX,AL         ;³do il clock (un breve impulso alto)  solo  per
        CALL    Clock         ;³la  memoria  interessata  dal  dato  a  8  bit
        INC     DI            ;³corrente; le rimanenti 3 memorie 74LS374 hanno
        LOOP    Out_1         ;Ùtutte le linee di clock a livello "0",inattive
        RET

;ÚÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄ¿
;³PROCEDURA  : Clock                                                         ³
;³DESCRIZIONE: Genera un impulso alto sulla linea di clock di una sola delle ³
;³             memorie 74LS374 coinvolte nel progetto;  le  rimanenti  hanno ³
;³             tutte le linee di clock a livello basso, disattive.           ³
;³             La memoria interessata dal clock Š quella di ordine CL-n, con ³
;³             n uguale al numero  di  memorie  coinvolte;  naturalmente  il ³
;³             valore di CL deve essere predisposto prima della chiamata.    ³
;ÀÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÄÙ
                              ;¿La memoria abilitata Š puntata dall'uscita del
                              ;³decoder 74LS139  puntata  dal  codice  binario
Clock:  ADD     DX,2          ;³applicato sui suoi ingressi di selezione a lo-
        MOV     AL,8          ;³ro volta fissati dal valore dei bit3,bit1,bit0
        SUB     AL,CL         ;³(invertiti internamente) predisposto  nel  Re-
                              ;³gistro di CONTROLLO 037AH cioŠ 000 per la pri-
                              ;³ma memoria (in alto nello schema)  e  111  per
                              ;Ùl'ultima (in basso nello schema)
        CMP     AL,03         ;¿Adatta il valore del bit3 al codice in AL:
        JBE     Clock1        ;³se AL<=03 il codice Š 0x00, 0x01, 0x10 o 0x11
        OR      AL,00001000B  ;Ùse AL>=04 il codice Š 1x00, 1x01, 1x10 o 1x11
Clock1: AND     AL,11111011B  ;¿L'impulso  di  clock Š  creato  effettivamente
        OUT     DX,AL         ;³forzando prima a "0"  e  poi a "1" il bit2 del
        OR      AL,00000100B  ;³medesimo registro; in  questo  modo si abilita
        OUT     DX,AL         ;³il decoder creando un impulso basso sull'usci-
        SUB     DX,2          ;³ta selezionata e il desiderato impulso alto di
        RET                   ;Ùclock sulla memoria, per effetto dell'inverter

Come preannunciato la gestione delle 8 memorie esterne è affidata ad un loop, per questo caricato a 8 (MOV CX,8); gli 8 bytes coinvolti nella gestione sono assunti dalla variabile Dato_64, predisposta in precedenza e puntata dall'istruzione LEA DI,Dato_64.

A partire da quello meno significativo, gli 8 bytes sono spediti, uno dopo l'altro tramite AL, sul Registro d'uscita 0378H/0278H (PRNdato) e resi disponibili sulle linee corrispondenti, i pin 2÷pin 9 del connettore della porta parallela

Non appena un byte è presente sulla porta d'uscita viene creato il necessario sincronismo di memorizzazione (clock) per la memoria 74LS374 a cui è destinato.

A questo pensa la sottoprocedura Clock, appositamente separata dalla precedente per evidenziarne la valenza; per comprendere meglio i concetti che descriverò tra poco può essere utile (se non l'hai già fatto ) aprire una seconda pagina con lo schema elettrico del progetto.

In breve è necessario controllare 4 linee del decoder binario 74LS138 con l'aiuto di altrettanti bit del Registro di controllo 037AH/027AH:

	i bit3, bit1, bit0 controllano le 3 linee di *selezione* del decoder, A sul pin1, B sul pin2 e C sul pin3
	il bit2 controlla contemporaneamente le 2 linee di *enable* del decoder, *G2A* e *G2B*, attive basse, pin 4 e pin 5

Poichè ciascuna delle 8 uscite del decoder (attive basse) è collegata (tramite in inverter) alla linea di clock (pin11) di una memorie esterna, è facile capire che il valore di controllo da predisporre sul Registro 037AH/027AH dovrà attivarle una alla volta, in sequenza.

La scelta del valore da scrivere sul Registro è influenzata anche dal fatto che le linee d'uscita di quest'ultimo (associate ai bit3,bit1,bit0) sono invertite internamente; tenendo conto di tutto la procedura Clock è stata studiata per forzare i bit3,bit2,bit1,bit0 del Registro al giusto valore, negli 8 casi in cui è chiamata.

	La prima volta il valore è 0000: il bit2 a 0 abilita il decoder e i bit3,bit1,bit0 a 000 (trasformato in 111, dagli inverter interni) selezionano l'uscita 7 del decoder, producendo un fronte attivo (di salita) sulla linea di clock della prima memoria (n°1), che copierà così sulla sua uscita il byte presente sulle linee dato della parallela.
	Le volte successive il valore sarà 0001, 0010, 0011, 1000, 1001, 1010 e 1011: in ogni caso il bit2 a 0 mantiene abilitato il decoder e i bit3,bit1,bit0 selezionano le altre uscite del decoder, dalla 6 alla 0, garantendo un fronte attivo di clock anche per le rimanenti memorie, dalla n°2 alla n°8

Da notare che la procedura Clock

	provvede ad aggiustare il valore binario necessario sui bit non consecutivi bit3,bit1,bit0 forzando il bit3 a 1 (OR AL,000001000B) se il valore di AL è maggiore di 3
	*prima* di generare un nuovo valore riporta momentaneamente il bit2 a 1 (OR AL,00000100B) per disabilitare tutte e 8 le linee di *clock* tra una fase e l'altra, lasciandole in questo stato (di attesa) anche al termine dell'ultima memorizzazione.

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