78LS138 74LS139 74LS153 74LS157 74LS158
7846 74LS47 74LS48 74LS49 9368 4511
74LS240 74LS241 74LS244 74LS373 74LS374
MC1488 MC1489 MAX232 UART16550 ADC0804
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 Data Sheet

Sezione Data Sheet

  LOGICA TTL - DECODER a 7 SEGMENTI

DECODER TTL 74LS49  3/3 [41 di 87] 

 

    74LS49 - Decoder da BCD a sette segmenti [TTL] per digit a catodo comune
     

    

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Va subito evidenziato che il 74LS49, come tutti gli altri Decoder TTL appartenenti alla categoria BCD to 7-segment, 7446, 74LS47 e 74LS48) è comunque in grado di processare tutte le possibili 16 combinazioni a 4 bit sulle 4 linee d'ingresso, ma non è stato progettato per interpretare le 6 combinazioni più significative, da (1010)2 a (1111)2; sta al programmatore evitare con cura che questo evento accada, altrimenti il digit ad esse collegato fornirà simboli improbabili, di norma inaccettabili.

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I valori binari accettabili sono dunque quelli da (0000)2 a (1001)2 che, come è noto, non solo sono le prime dieci sequenze Binarie Pure a 4 bit ma anche le dieci parole del Codice BCD; per ciascuna di esse il componente attiverà in uscita i segmenti necessari per creare i corrispondenti 10 simboli del sistema di numerazione decimale, da (0)10 a (9)10, esattamente quelli che verranno proposti sul digit controllato dal Decoder.

 
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Tutti e quattro i componenti citati trattano in modo particolare le possibili 6 combinazioni a 4 bit non appartenenti al codice BCD [da (1010)2=(10)10 a (1111)2=(15)10, eventualmente proposte sulle linee d'ingresso] attivando le linee d'uscita di segmento per formare i seguenti simboli:

    

    

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La disponibilità di questi simboli, piuttosto di altri, ha una logica: chi si è cimentato nel progetto di una macchina combinatoria di questo tipo a partire dalla sua tabella di verità è a conoscenza delle cosiddette condizioni di indifferenza; in breve (sarebbe divertente poter andare più a fondo, ma non è questo l'ambito giusto...) partendo dal presupposto che le ultime 6 combinazioni non devono mai essere fornite (perché non appartenenti al codice BCD), il valore logico che la rispettiva uscita può assumere è indifferente, cioè può essere assunto a piacere uguale a "1" o a "0", nel modo più conveniente ai fini del progetto stesso.
Se, nonostante il divieto, si fornisce (a progetto finito) una delle ultime 6 combinazioni vietate, l'aspetto delle uscite è dunque legato alle scelte imposte alle relative condizioni di indifferenza e si traduce (nel nostro caso) in quello mostrato dalla precedente figura.

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Il caso ha voluto che due dei simboli ottenuti siano realistici [una "c" per (1010)2 e una "t" per (1110)2], ma soprattutto l'ultimo [mostrato con ingressi a (1111)2] si presta ad una interessante considerazione: se il programmatore impone in ingresso il codice binario (non BCD) 1111 otterrà come effetto quello di spegnere il digit controllato dal Decoder; vedremo tra un po' che questo effetto, decisamente utile, è gestibile anche da hardware ma la possibilità di ottenerlo direttamente da software ha il grande vantaggio di non costare nulla!

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L'aspetto delle uscite per ognuna delle 16 combinazioni possibili è quindi quello mostrato dalla seguente figura; da notare che le scelte imposte dal progetto per la visualizzazione del "6" (0110)2 e del "9" (1001)2, portano a simboli entrambi privi del trattino esterno, previsto invece (come in e in ) da altri decoder:

    

    

bulletI seguenti link rendono disponibili i Data Sheet originali, in formato PDF:

    

Data Sheet - Hitachi Data Sheet - Texas Instruments

    

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Logica TTL - DECODER TTL 74LS49
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74LS373 | 74LS374 | 7446 | 74LS47 | 74LS48 | 74LS49 | 9368 | 4511 | FND500/FND507
74LS373 | 74LS374 | ADC0804 | HD44780 | MC1488 | MC1489 | MAX232 | UART16550
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